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Questo libro propone la progettazione e l'architettura del filtro di de-blocco (DBF) che rimuove gli artefatti di blocco nel nuovo standard emergente High Efficiency Video Coding (HEVC). Il DBF di HEVC impiega due tipi di filtro, normale e forte. In questo libro viene proposta l'architettura di entrambe le modalità di filtraggio. Le memorie distribuite e i due percorsi dati aumentano il parallelismo e rendono l'architettura più efficiente. L'architettura proposta è stata prima implementata in MATLAB 2013®, poi descritta utilizzando Verilog in MODELSIM 10.2c® e infine sintetizzata in Xilinx ISE Design Suite 14.5®. L'architettura proposta è descritta in Verilog e implementata su FPGA. L'architettura è in grado di calcolare in tempo reale video 4k UHD a 30fps utilizzando 46,65 milioni di clock. Il numero totale di gate equivalenti dell'architettura proposta è di 11,4K per l'implementazione su scheda Virtex-4 e di 46K per la scheda Virtex-5.
About the author
Awais Khan ha conseguito la laurea in Ingegneria elettronica presso l'Int. Islamic University, Islamabad, Pakistan. Ha conseguito un master in ingegneria elettrica (specializzazione in tecniche digitali) presso l'Università di Ingegneria e Tecnologia di Taxila, Pakistan. Ha pubblicato 5 articoli in riviste e 1 in conferenze sul filtro di deblocking HEVC e attualmente lavora in un centro di ricerca e sviluppo del Pakistan.
