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Los PLL funcionan ajustando continuamente un oscilador controlado por tensión o corriente para igualar (bloquear) la fase y la frecuencia de una señal de entrada. Un circuito llamado comparador de fase hace que el VCO busque y se bloquee en la frecuencia deseada, que se ajusta mediante un oscilador controlado por tensión. Cuando la frecuencia del VCO difiere de la frecuencia de referencia, el comparador de fase produce una tensión de error. El bucle de enganche de fase digital (DPLL) es uno de los dispositivos más importantes en casi todos los sistemas electrónicos. Este libro introduce el diseño de DPLL utilizando tecnología CMOS sub-micron de 45nm e implementado utilizando el software microwind 3.1. El software microwind 3.1 se utiliza para diseñar y simular un circuito integrado a nivel de descripción física. El rendimiento del DPLL también se observa para las diferentes frecuencias de entrada variables y el resultado se observa hasta la marca. El rango de bloqueo para el DPLL y el tiempo de bloqueo también se observó como se esperaba.
About the author
M. Shankar N. Dandare (M.Sc., M.E., Ph. D.) est professeur au département d'ingénierie électronique du Babasaheb Naik College of Engineering, Pusad, Inde. Il est membre de nombreux organismes professionnels tels que l'ISTE, l'AMIE et l'IETE. Il a 34 ans d'expérience dans l'enseignement de l'ingénierie aux niveaux UG et PG et est l'auteur principal de trois livres d'ingénierie.
