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Informationen zum Autor L'auteur a été titulaire d'un doctorat et d'un master en 2011 et 2007 respectivement à l'Université Paul Verlaine Metz, France.Depuis, il travaille comme chercheur à l'Université de Technologie Tallinn, Estonie. Son travail de recherche est concentre sur la conception des systèmes électronique embarque tolérant aux fautes. Klappentext Dans cette livre, nous proposons une nouvelle approche pour la conception d'un processeur tolérant aux fautes. Celle-ci répond à plusieurs objectifs dont celui d'obtenir un niveau de protection élevé contre les erreurs transitoires et un compromis raisonnable entre performances temporelles et coût en surface. Le processeur résultant sera utilisé ultérieurement comme élément constitutif d'un système multiprocesseur sur puce (MPSoC) tolérant aux fautes. Les concepts mis en oeuvre pour la tolérance aux fautes reposent sur l'emploi de techniques de détection concurrente d'erreurs et de recouvrement par réexécution. Les éléments centraux de la nouvelle architecture sont, un coeur de processeur à pile de données de type MISC (Minimal Instruction Set Computer) capable d'auto-détection d'erreurs, et un mécanisme matériel de journalisation chargé d'empêcher la propagation d'erreurs vers la mémoire centrale (supposée sûre) et de limiter l'impact du mécanisme de recouvrement sur les performances temporelles. Les résultats, obtenus sans recherche d'optimisation poussée, montrent clairement la pertinence de l'approche proposée, en offrant un bon compromis entre protection et performances.
About the author
Mohsin Amin, M.SC.: Chemistry from Government College UniversityFaisalabad.
